据TechXplore网8月14日消息，美国加州大学洛杉矶分校研究人员改进基准量子电路以优化量子计算机性能。由于量子计算机受到退相干效应的影响，一旦对其进行编码，量子态会迅速坍塌。若将电路的深度减小，则可有效延缓量子退相干的时间，利于执行有效的量子计算。为此，加州大学洛杉矶分校研究人员设计出具有最优化深度或大小的基准量子电路系列，其较小的电路也意味着可以将更多的计算单元集成到现有的量子计算机中。量子计算机工程师可以使用其基准来改进设计工具，从而找到最优的电路设计方案，以提升量子电路效率、优化量子计算机性能。
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